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功能描述

cadence 軟件

mentor軟件

基

本

功

能

方

面

原理圖輸入

有

有

原理圖互檢

有

無

pcb建庫工具

有,很方便

有，很麻煩

產(chǎn)生光繪文件

有

有

產(chǎn)生生產(chǎn)數(shù)據(jù)文件

有

有

布局，布線工具

有，性能和集成度最好

有，無集成環(huán)境

無網(wǎng)格布線器

有，性能和集成度最好

有，剛購買較差

物理封裝庫

有

有

機(jī)械圖接口

有

有，未報(bào)

PCB可測性工具

有

無

可裝配性設(shè)計(jì)

有

有

可生產(chǎn)性設(shè)計(jì)

有

有

庫管理

14.5 有，Synchronicity

有，未報(bào)

Unix & NT 平臺(tái)支持

統(tǒng)一數(shù)據(jù)庫，工作穩(wěn)定

不統(tǒng)一，不穩(wěn)定

單一設(shè)計(jì)數(shù)據(jù)庫

有

Veribest,Boardsation,ICX

流程的無縫集成

有

無

高

速

P

C

B

設(shè)

計(jì)

及

仿

真

方

面

板極熱分析工具

有，未報(bào)

不知道

系統(tǒng)板極時(shí)序分析

有

有

靜態(tài)時(shí)序分析

是Verilog-XL的子功能

有

布線延遲

有

有

拓?fù)浣Y(jié)構(gòu)分析

有

有

阻抗控制

有

有

差分線布線

有

無

串?dāng)_噪聲分析

有

有

集膚影響

有

振鈴，正負(fù)脈沖，走線延遲分析

有

有

電源/地彈檢測

有

無

EMC，EMI分析

有

無

仿真波形顯示

有

有

電氣規(guī)則驅(qū)動(dòng)的交互式布線

有

部分支持

電氣規(guī)則驅(qū)動(dòng)的自動(dòng)布線

有

有

布線前“What-if”分析

有

有

布線后”What-if”分析

有

有

電源平面分析

有，未報(bào)

無

物理規(guī)則驅(qū)動(dòng)

有

無

Spice模型的支持

有

無

行為級(jí)仿真能力

有

有

IBIS支持

有

有

結(jié)構(gòu)級(jí)宏模型的支持

有

無

從PCB提取拓?fù)浣Y(jié)構(gòu)

有

無

面向拓?fù)浣Y(jié)構(gòu)的原理圖

有

無

參數(shù)掃描

有

無

拓?fù)浣Y(jié)構(gòu)模板

有

無

約束驅(qū)動(dòng)布線

有

不完整

時(shí)序驅(qū)動(dòng)的層次規(guī)劃

有

有

成熟的高速高密度布線器

有

較差

后驗(yàn)證

有

部分支持